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崗位職責(zé)：
1、負(fù)責(zé)或參與整體芯片floor plan的規(guī)劃，Die Size的評估及封裝的選取和評估；
2、負(fù)責(zé)驅(qū)動類和電源管理類芯片Block Level及Top Level的版圖設(shè)計；
3、負(fù)責(zé)版圖寄生參數(shù)的提取，并根據(jù)電路設(shè)計的需求對版圖進(jìn)行修改；
4、完成版圖物理驗證，包括DRC，LVS，ERC，EM等，完成Tapeout及后續(xù)相關(guān)工作；
5、負(fù)責(zé)項目后端的開發(fā)進(jìn)度，與foundry緊密合作確保tape out按期完成；
6、負(fù)責(zé)撰寫相關(guān)layout文檔；

任職要求：
1、本科學(xué)歷，2年以上相關(guān)工作經(jīng)歷，211/985 背景優(yōu)先；
2、熟悉BCD和HV工藝，對工藝制程有一定理解，有扎實(shí)版圖設(shè)計理論基礎(chǔ)；
3、熟悉集成電路設(shè)計基本流程，熟練使用Cadence，Calibre等主流版圖設(shè)計工具，有runset修改能力及版圖debug能力；
4、有TOP Level設(shè)計和Tapeout經(jīng)驗優(yōu)先，能對設(shè)計給出一定反饋或建議更佳。
5、英語4級以上，讀寫能力良好。
6、工作地點(diǎn)：上海。