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一、崗位職責(zé)
1、圖像處理算法FPGA實(shí)現(xiàn)
負(fù)責(zé)三維成像算法的FPGA架構(gòu)設(shè)計(jì)、RTL實(shí)現(xiàn)及優(yōu)化。
2、FPGA系統(tǒng)開發(fā)與優(yōu)化
設(shè)計(jì)高速相機(jī)采集與處理系統(tǒng)，優(yōu)化MIPI/subLVDS/DDR接口帶寬利用率。
實(shí)現(xiàn)多傳感器圖像數(shù)據(jù)的同步采集及數(shù)據(jù)處理，支持嵌入式系統(tǒng)集成。
3. 性能驗(yàn)證與調(diào)試
搭建仿真測(cè)試平臺(tái)（Matlab/Python協(xié)同驗(yàn)證），確保算法硬件實(shí)現(xiàn)的準(zhǔn)確性。
通過時(shí)序約束、流水線設(shè)計(jì)、資源復(fù)用等手段優(yōu)化FPGA性能，滿足功耗與面積要求。
4. 技術(shù)攻關(guān)與團(tuán)隊(duì)協(xié)作
研究三維成像算法，推動(dòng)技術(shù)落地與專利布局。
與算法、硬件團(tuán)隊(duì)協(xié)作，制定FPGA解決方案，并輸出完整設(shè)計(jì)文檔。

二、崗位要求
1. 硬性條件
學(xué)歷與經(jīng)驗(yàn)
本科以上學(xué)歷，電子工程/通信/計(jì)算機(jī)相關(guān)專業(yè)，5年以上FPGA開發(fā)經(jīng)驗(yàn)（圖像處理領(lǐng)域3年 ）。
有三維成像算法（結(jié)構(gòu)光，線激光），圖像壓縮或視頻編解碼等圖像處理相關(guān)FPGA項(xiàng)目經(jīng)驗(yàn)者優(yōu)先（需提供案例說明）。
2. 技術(shù)能力
精通Verilog/VHDL，掌握AXI-Stream、DMA等高速接口設(shè)計(jì)，熟悉Xilinx Zynq或Intel Cyclone系列開發(fā)。
有圖像處理相關(guān)經(jīng)驗(yàn)，能獨(dú)立完成算法RTL實(shí)現(xiàn)與優(yōu)化。
熟練使用Vivado/Quartus、Modelsim等工具，具備Matlab/C/C 協(xié)同驗(yàn)證能力。
3. 加分項(xiàng)
熟悉HLS（高層次綜合）開發(fā)流程或AI加速器設(shè)計(jì)（如CNN硬件加速）。
有CameraLink/MIPI接口開發(fā)經(jīng)驗(yàn)，或參與過工業(yè)相機(jī)項(xiàng)目者優(yōu)先。
4. 軟性素質(zhì)
具備良好的技術(shù)文檔撰寫能力（中英文），能主導(dǎo)技術(shù)評(píng)審與問題復(fù)盤。
較強(qiáng)的抗壓能力，適應(yīng)快節(jié)奏研發(fā)環(huán)境，具備團(tuán)隊(duì)協(xié)作精神。